Celoxica Agility Compiler v1.3
CeloxicaAgilityCompilerv1.3英文正式版(AgilityC編譯器軟體)
安裝序號:
序號產生器放至於keygen夾內
內容說明:
Celoxica公司發佈了AgilityC編譯器，它可以將SystemC的設計綜合到FPGA裡。除了瞄準可
重配置邏輯器件外，該工具還能為ASIC設計生成RTL代碼。Celoxica公司通過推出Agility
編譯器擴展了DK設計工具套件的功能，使之不再是僅僅進行Handel-C綜合，因為編譯器
能在工具流程與Handel-C工具的流程幾乎相同的情況下支援SystemC綜合。
SystemC是一種基於C++的有利於系統級設計的建模語言。SystemC分類庫根據標準C++
分層，並使之擴展，以便規定並發行為、時間順序操作、用於描述硬體的數據類型、結構分
層和仿真支援。在Celoxica公司和ForteDesignSystems公司2004年推出SystemC綜合
工具之前，SystemC工具的支援只包括建模和仿真。
開發行為綜合技術的ForteDesignSystems公司，提供一條從高級算法到RTL的自動化路
徑（其中包括綜合、驗證和共同仿真），使設計師能利用更高級別的設計抽像。
該公司的Cynthesizer根據未定時的SystemC模型和設計師提供的一組指令和約束條件
（如時鐘速度、等待時間、流水線運作、循環展開）生成完全定時的RTL實現。只要把一
組組不同的指令提供給同一個設計源，設計師就能探索並分析處理性能與晶片面積之間的折
衷方案。Cynthesizer的自動化行為綜合功能包括操作調度、週期定時、狀態機實現、控制
和數據路徑設計、資源分配、RTL生成。Celoxica公司對於C語言綜合併不陌生。這家英國
公司的DK設計套件提供了採用其專有語言Handel-C的綜合和仿真。AgilityC的新穎之處在
於它採用工業標準的SystemC語言進行綜合。Celoxica公司專注於可重配置邏輯，不僅包括
FPGA，還包括一些新的架構，如Elixent公司所謂的「可編程算法處理」架構。「把系統級
設計的重點放在ASIC是完全錯誤的。」Celoxica的副總裁JeffJussell表示，「C設計人員
應該採用FPGA創建首個原型。」AgilityC能產生用於ASIC設計的RTL代碼，但它真正的重點
是可編程邏輯。「該工具是面向DSP的，」Jussell表示，「瞄準的應用包括數字成像和信號
處理等。」與明導的Catapult不同，AgilityC使用定時的SystemC描述。「我們相信這是向
設計師提供控制能力的最有效方式。」Jussell說，「如果你正在使用C語言，並試圖用硬體
實現設計，那麼一點都不懂硬體功能肯定是行不通的。」
英文說明:
TheAgilityCompilerprovidesbehavioraldesignandsynthesisforSystemC.
ItisasinglesolutionforFPGAdesignandASIC/SoCprototyping.Early
TLMmodelscanbequicklyrealizedinworkingsiliconyieldingaccurate
designmetricsandRTLforPhysicaldesign.
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